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 digital 设计工程师

南昌县  1341

2019-10-16面谈

 已验证    推荐企业

岗位信息

招聘职位： digital 设计工程师
招聘人数： 1 人
学历要求： 本科
工作经验： 1-3年
公司福利：

职位描述

1.熟悉verilog；
2.熟悉数字逻辑设计, 包括模块架构设计，RTL编程, 仿真验证, FPGA验证等；
3.了解ASIC前端设计流程及相关EDA工具，包括电路综合、时序分析等。

福利：双休，五险一金，包吃，包住，加班补贴，节日福利等

招聘企业

江西联智集成电路有限公司

100-200人 | 南昌市
电子/电气/仪器仪表

工作地点

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